课程《FPGA 原理与应用》_题库列表第12页_查题网

FPGA 原理与应用

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[单选题] 关于VerilogHDL中的数字，请找出以下数字中最大的一个：（）。 A.8′b1111_1110 B.3′o276 C.3′d170 D.2′h3E
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- 2021-11-07 16:20:32
[单选题] 下列EDA软件中，哪一个不具有逻辑综合功能：（）。 A.ISE B.ModelSim C.QuartusII D.Synplify
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- 2021-11-07 16:20:32
[单选题] 在VerilogHDL的逻辑运算中，设A=8'b11010001,B=8'b00011001,则表达式“A&B”的结果为（） A.8'b00010001 B.8'b11011001 C.8'b11001000 D.8'b00110111
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- 2021-11-07 16:20:32
[单选题] 在verilogHDL的always块本身是（）语句 A.顺序 B.并行 C.顺序或并行 D.串行
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- 2021-11-07 16:20:32
[单选题] IP核在EDA技术和开发中具有十分重要的地位，IP是指（）。 A.知识产权 B.互联网协议 C.网络地址 D.都不是
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- 2021-11-07 16:20:32
[单选题] 用VerilogHDL的assign语句建模的方法一般称为（）方法。 A.连续赋值 B.并行赋值 C.串行赋值 D.函数赋值
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- 2021-11-07 16:20:32
[单选题] 任VerilogHDL的端口声明语句中，用（）关键字声明端口为双向端口 A.inout B.INOUT C.BUFFER D.buffer
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- 2021-11-07 16:20:32
[单选题] 在VHDL语言中，下列对进程（PROCESS）语句的语句结构及语法规则的描述中，不正确的是：____ A.PROCESS为一无限循环语句 B.敏感信号发生更新时启动进程，执行完成后，等待下一次进程启动 C.当前进程中声明的变量不可用于其他进程 D.进程由说明语句部分、并行语句部分和敏感信号参数表三部分组成
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- 2021-11-07 16:20:32
[单选题] 状态机编码方式中，其中___占用触发器较多，但其简单的编码方式可减少状态译码组合逻辑资源，且易于控制非法状态。 A.一位热码编码 B.顺序编码 C.状态位直接输出型编码 D.格雷码编码
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- 2021-11-07 16:20:32
[单选题] 下面既是并行语句又是串行语句的是（） A.变量赋值 B.信号赋值 C.PROCESS语句 D.WHEN…ELSE语句
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- 2021-11-07 16:20:32