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大连理工大学 / 数字电路与系统
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大连理工大学 / 数字电路与系统
正确率:100%
时钟RS触发器输入端S=R=0时,CLK=1,则触发器()。
A.两个输出端同时变为1
B.次态为0
C.次态为1
D.保持原态
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数字电路与系统
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