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河南成教 / 银行会计
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[单选题] 在一个VHDL设计中idata是一个信号,数据类型为integer,数据范围0to127,下面哪个赋值语句是正确的_____。(信号赋值符号<=) A.idata:=32; B.idata<=16#A0#;(十进制数为:10*16=160,idata范围为0~127) C.idata<=16#7#E1;(十进制数为:7*16^1=112) D.idata:=B#1010#;
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